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前言
第1章 EDA概述
1.1 EDA工程简介
1.2 EDA技术的发展历程和未来展望
1.2.1 计算机辅助设计（CAD）阶段
1.2.2 计算机辅助工程设计（CAE）阶段
1.2.3 现代电子设计自动化（EDA）阶段
1.2.4 EDA技术的未来展望
1.3 EDA技术的应用
1.3.1 PCB设计
1.3.2 ASIC设计
1.3.3 CPLD/FPGA设计
1.4 EDA工程的设计流程
1.4.1 设计输入
1.4.2 逻辑综合和优化
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1.4.3 布局布线和适配
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1.4.4 工程设计的仿真
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1.4.5 目标器件的编程和下载
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1.4.6 硬件电路的后仿真验证和测试
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1.5 EDA集成开发工具
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1.5.1 Quartus II
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1.5.2 ISE+ModelSim
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1.5.3 ispLEVER
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1.5.4 其他开发工具
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1.6 EDA技术的学习重点和学习方法
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1.6.1 EDA技术的学习重点
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1.6.2 EDA技术的学习方法
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本章小结
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思考和练习
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第2章 可编程逻辑器件
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2.1 可编程逻辑器件概述
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2.1.1 可编程逻辑器件的发展
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2.1.2 可编程逻辑器件的分类
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2.2 PLD内部结构的表示方法
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2.3 CPLD的基本结构和工作原理
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2.3.1 CPLD的基本结构
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2.3.2 Lattice公司的CPLD
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2.3.3 Altera公司的CPLD
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2.4 FPGA的结构和工作原理
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2.4.1 FPGA的基本结构
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2.4.2 Altera公司的FPGA
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2.4.3 Xilinx公司的FPGA
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2.5 FPGA的配置方式
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2.5.1 主动串行配置
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2.5.2 主动并行配置
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2.5.3 菊花链配置
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2.6 CPLD/FPGA的应用选型
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2.6.1 器件逻辑资源的选择
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2.6.2 芯片速度的选择
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2.6.3 器件功耗的选择
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2.6.4 器件封装的选择
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2.6.5 CPLD/FPGA的选择
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本章小结
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思考和练习
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第3章 VHDL硬件描述语言
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3.1 硬件描述语言概述
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3.1.1 HDL硬件描述语言
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3.1.2 HDL语言的种类
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3.1.3 VHDL语言的特点
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3.1.4 VHDL和Verilog的比较
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3.1.5 VHDL的硬件环境
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3.2 VHDL程序的基本结构
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3.2.1 VHDL的设计风格
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3.2.2 VHDL设计简述
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3.2.3 VHDL的实体声明
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3.2.4 VHDL的结构体
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3.3 VHDL的基本词法
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3.3.1 标识符
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3.3.2 数据对象
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3.3.3 数据类型
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3.3.4 类型转换
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3.3.5 运算操作符
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3.4 VHDL的基本语句
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3.4.1 赋值语句
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3.4.2 IF语句
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3.4.3 CASE语句
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3.4.4 LOOP语句
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3.4.5 PROCESS进程语句
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3.4.6 COMPONENT元件例化语句
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3.4.7 PORT MAP端口映射语句
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3.5 VHDL的描述风格
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3.5.1 行为级描述
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3.5.2 数据流描述
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3.5.3 门级描述
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3.5.4 混合描述
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本章小结
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思考和练习
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第4章 Quartus II 操作指南
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4.1 Quartus II 基本设计流程
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4.1.1 创建工程
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4.1.2 编译工程
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4.1.3 时序仿真
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4.1.4 Viewer工具
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4.1.5 引脚锁定和下载
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4.2 嵌入式逻辑分析仪SignalTap II
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4.2.1 SignalTap II的启动
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4.2.2 调入待测信号
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4.2.3 SignalTap II 的参数设置
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4.2.4 SignalTap II 文件的保存和编译下载
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4.2.5 SignalTap II 的采样分析
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4.3 LPM_ROM宏模块的使用
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4.3.1 LPM_ROM宏模块的工作原理
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4.3.2 初始化数据文件
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4.3.3 定制LPM_ROM元件
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4.3.4 顶层文件的仿真测试
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本章小结
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思考和练习
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第5章 VHDL基本逻辑电路设计
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5.1 组合逻辑电路设计
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5.1.1 基本门电路的设计
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5.1.2 三态门及总线缓冲器的设计
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5.1.3 优先编码器的设计
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5.1.4 译码器的设计
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5.1.5 运算器的设计
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5.1.6 多路选择器的设计
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5.2 时序逻辑电路设计
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5.2.1 触发器的设计
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5.2.2 寄存器的设计
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5.2.3 计数器的设计
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5.3 存储器设计
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5.3.1 只读存储器ROM的设计
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5.3.2 静态数据存储器SRAM的设计
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5.3.3 先进先出堆栈FIFO的设计
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5.4 状态机设计
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5.4.1 状态机概述
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5.4.2 Moore状态机的设计
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5.4.3 Mealy状态机的设计
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5.4.4 容错状态机的设计
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本章小结
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思考和练习
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第6章 VHDL语句进阶
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6.1 并行语句
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6.1.1 块语句（BLOCK）
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6.1.2 生成语句（GENERATE）
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6.1.3 报告语句（REPORT）
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6.1.4 并行断言语句（ASSERT）
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6.1.5 过程调用语句（PROCEDURE）
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6.2 顺序语句
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6.2.1 WAIT语句
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6.2.2 NEXT语句
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6.2.3 EXIT语句
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6.2.4 NULL语句
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6.2.5 RETURN语句
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本章小结
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思考和练习
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第7章 VHDL的属性描述和仿真延时
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7.1 预定义属性
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7.2 数值类属性函数
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7.2.1 数值类型属性函数
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7.2.2 数值数组属性函数
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7.2.3 数值块属性函数
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7.3 函数属性
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7.3.1 函数类型属性
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7.3.2 函数数组属性
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7.3.3 函数信号属性
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7.4 信号（SIGNAL）属性
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7.4.1 带DELAYED（time）属性的信号SIGNAL
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7.4.2 带STABLE（time）属性的信号SIGNAL
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7.4.3 带QUIET（time）属性的信号SIGNAL
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7.4.4 带TRANSACTION属性的信号SIGNAL
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7.5 数据类型的属性函数
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7.6 数据区间的属性函数
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7.7 VHDL的设计仿真
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7.7.1 仿真的概念
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7.7.2 仿真延时
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7.7.3 仿真周期
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7.8 时间数字转化器（TDC）的设计
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7.8.1 时间数字转化器（TDC）的应用
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7.8.2 TDC的工作原理
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7.8.3 TDC的分类
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7.8.4 延时链结构TDC在FPGA上的实现
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本章小结
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思考和练习
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第8章 VHDL层次化程序设计
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8.1 层次化程序设计方法
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8.2 库和程序包
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8.2.1 库
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8.2.2 程序包
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8.2.3 常用的程序包
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8.3 文件输入/输出程序包
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8.3.1 TEXTIO程序包语法
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8.3.2 TEXTIO程序包的过程函数
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8.3.3 TEXTIO程序包的调用
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8.4 元件的配置
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8.4.1 默认连接和默认配置
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8.4.2 元件配置
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8.5 子程序
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8.6 重载
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8.6.1 函数重载
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8.6.2 运算符重载
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8.6.3 别名（替换名）
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本章小结
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思考和练习
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第9章 VHDL的数字系统设计
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9.1 数字系统概述
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9.2 数字系统的设计方法和设计流程
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9.2.1 数字系统的设计方法
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9.2.2 数字系统的设计流程
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9.3 数字系统设计实例
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9.3.1 7段数码管驱动电路的设计
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9.3.2 键盘接口的设计
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9.3.3 DAC接口的设计
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9.3.4 ADC接口的设计
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9.3.5 八音盒的设计
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9.3.6 UART接口的设计
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本章小结
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实验练习
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第10章 VHDL在通信和DSP系统中的应用
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10.1 通信与DSP系统概述
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10.2 通信与DSP系统设计实例
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10.2.1 ASK调制解调器的设计
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10.2.2 快速加法器的设计
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10.2.3 快速乘法器的设计
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10.2.4 CORDIC极坐标转换器的设计
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10.2.5 FIR数字滤波器的设计
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10.2.6 IIR数字滤波器的设计
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本章小结
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实验练习
更新时间：2018-12-30 07:40:54
完结共220章
倒序